{"id":3025,"date":"2020-11-05T08:00:00","date_gmt":"2020-11-05T08:00:00","guid":{"rendered":"https:\/\/framos.com\/news\/reduktion-von-design-risiken-durch-framos-ip-core-fuer-slvs-ec-2-0\/"},"modified":"2024-04-24T22:13:58","modified_gmt":"2024-04-24T22:13:58","slug":"reduktion-von-design-risiken-durch-framos-ip-core-fuer-slvs-ec-2-0","status":"publish","type":"news","link":"https:\/\/framos.com\/de\/news\/reduktion-von-design-risiken-durch-framos-ip-core-fuer-slvs-ec-2-0\/","title":{"rendered":"Reduktion von Design-Risiken durch FRAMOS IP Core f\u00fcr SLVS-EC 2.0"},"content":{"rendered":"
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\nFRAMOS bietet seinen SLVS-EC RX IP Core zusammen mit umfassendem Support durch ein Development Kit und eine Referenz-Implementierung f\u00fcr das aktuelle Release V2.0 der Sensorschnittstelle SLVS-EC an. Die neue Version 2.0 unterst\u00fctzt mit bis zu 5Gbit\/s auf allen 8 Lanes die doppelte Datenrate der Vorg\u00e4ngerversion 1.2. Ingenieure, die L\u00f6sungen mit Xilinx FPGAs und SoCs entwickeln, k\u00f6nnen jetzt mit dem FRAMOS SLVS-EC RX IP Core, dem Evaluation-Board und dem Referenzbeispiel ihre L\u00f6sungen mit geringerem Risiko entwickeln und gleichzeitig von den Vorteilen der neuesten Sony High-Speed-Schnittstelle profitieren.<\/p>\n

Verk\u00fcrzte Markteinf\u00fchrungszeit mit universellem SLVS-EC RX IP Core<\/strong>SLVS-EC RX IP Core<\/strong><\/h2>\n

Der FRAMOS SLVS-EC RX IP Core erm\u00f6glicht die einfache Integration von SLVS-EC Sensoren und nimmt Kunden die Implementierung dieser komplexen Datenschnittstelle und deren Risiken bei der Integration ab, wodurch sich die Markteinf\u00fchrung beschleunigen und die Planbarkeit verbessern l\u00e4sst. Er unterst\u00fctzt alle Funktionen des SLVS-EC 2.0 Standards und ist damit einzigartig im Markt. Der IP Core ist vielseitig und sensorunabh\u00e4ngig – und somit kompatibel mit allen standardkonformen Bildsensoren. Er unterst\u00fctzt s\u00e4mtliche Pixelformate von 8 bis 16 Bit; diese k\u00f6nnen im Betrieb dynamisch gewechselt werden. Weiterhin ist die automatische Fehlererkennungs- und Korrekturfunktion (ECC) ein fester Bestandteil des IP Cores. Die Funktion kann optional aktiviert werden, um die Robustheit der Daten\u00fcbertragung weiter zu erh\u00f6hen. Dar\u00fcber hinaus bietet der IP Core die flexible Unterst\u00fctzung verschiedener Lane-Konfiguration und das Datenhandling von sich \u00fcberlappenden ROIs (Region of Interest) gem\u00e4\u00df des Standards in Version 2.0.<\/p>\n

FRAMOS IP Core im umfassenden Development Kit<\/strong><\/h2>\n

\"SLVS-EC-IP-Core-by-FRAMOS-Scheme\"
\nDas FRAMOS SLVS-EC RX IP Core Development Kit f\u00fcr Xilinx FPGAs und SoCs bietet eine betriebsbereite Hardware-Umgebung, die vollst\u00e4ndig im FRAMOS Sensor Modul Ecosystem integriert ist. Es unterst\u00fctzt Kunden bei der Evaluierung und erm\u00f6glicht die Integration des FRAMOS IP Core in typische Kameradesigns auf Basis einer exemplarischen, vollst\u00e4ndig dokumentierten Bildpipeline.
\nDas Development Kit enth\u00e4lt unter anderem:<\/p>\n

    \n
  • FRAMOS Sensor Modul (FSM)<\/strong><\/li>\n
  • FRAMOS Sensor Adapter (FSA)<\/strong><\/li>\n
  • FRAMOS Prozessor Adapter (FPA)<\/strong><\/li>\n<\/ul>\n

    Alles in allem bietet die Gesamtausstattung des Development Kits Entwicklern die bestm\u00f6gliche Unterst\u00fctzung. Zudem enth\u00e4lt es ein Flex-Kabel, einen Tripod-Adapter und ein Softwarepaket mitsamt Evaluierungsversion des SLVS-EC RX IP Core und ein Beispiel f\u00fcr ein Referenzdesign, um den Entwicklern von Kamerasystemen die Arbeit wesentlich zu erleichtern und die Markteinf\u00fchrungszeit erheblich zu verk\u00fcrzen.<\/p>\n

    \nChris Baldwin, FPGA IP Experte und Technical Service Manager bei FRAMOS, sagt hierzu: „Die neue Version SLVS-EC 2.0 bietet unseren Kunden viele Vorteile. Sie unterst\u00fctzt schnellere Sensoren, hohe Aufl\u00f6sungen, erlaubt kompakte Designs sowie gr\u00f6\u00dfere Kabell\u00e4ngen und sie zeichnet sich aufgrund der Fehlererkennung und -korrektur durch eine hohe Robustheit aus.“\n<\/p><\/blockquote>\n

    Von allen SLVS-EC 2.0 Vorteilen profitieren
    <\/strong><\/h2>\n

    Mit SLVS-EC 2.0 kann die Performance neuester Premium-Sensortechnologie voll ausgenutzt werden, z.B. bei der Pregius S (Gen. 4) Serie sowie bei zuk\u00fcnftigen CMOS-Sensoren. Ebenso erm\u00f6glicht SLVS-EC bei Systemen mit geringerer Bandbreite eine gr\u00f6\u00dfere Designfreiheit, einfachere PCB-Designs und robustere Signalpfade, da weniger Pins und Leiterbahnen zu ber\u00fccksichtigen sind. Um das inh\u00e4rente Rauschen der zahlreichen komplexen Komponenten zu kontrollieren und die damit verbundenen Probleme zu l\u00f6sen, sind nicht nur einfallsreiche Designer notwendig, sondern auch tolerante Technologien.
    \nDie Vorteile im Vergleich zu \u00e4hnlichen Schnittstellen, wie SLVS, Sub-LVDS, MIPI CSI-2, liegen auf der Hand: l\u00e4ngere Signalpfade, gr\u00f6\u00dfere Toleranzen beim Design und bei der Fertigung von Kabelwegen sowie eine h\u00f6here Flexibilit\u00e4t bei der Zusammenschaltung und Verkabelung. Dank der Embedded Clock und den Funktionen zur Fehlererkennung und -korrektur erf\u00fcllt SLVS-EC 2.0 die Anforderungen der modernsten Embedded Vision Systeme.<\/p>\n

    Verschiedene Anwendungen in unterschiedlichen M\u00e4rkten
    <\/strong><\/h2>\n

    Andr\u00e9 Brela, Embedded Vision Produktmanager bei FRAMOS, sagt: „Schon vor der Einf\u00fchrung von SLVS-EC 2.0 konnten wir im Markt zunehmend die Forderung nach h\u00f6heren per-Lane Bandbreiten wahrnehmen, um speziell in High-End-Applikationen Designaufw\u00e4nde zu reduzieren. Zugleich wissen wir aus eigenen Erfahrungen, wie auch standardisierte und funktionsreiche Schnittstellen bereits auf Sensorebene die Integration stark modularisieren und vereinfachen k\u00f6nnen. Wir sehen t\u00e4glich Anwendungen, die von diesen neuen Sensorgenerationen sowie SLVS-EC profitieren, in denen kurze Designzyklen notwendig sind.\u201c Und er f\u00fcgt hinzu: \u00e2\u20ac\u017eDie neueste Sensortechnologie wird den Aufwand bei der Entwicklung von industriellen High-Speed- und Batch-Scansystemen weiter reduzieren, wo derzeit noch gro\u00dfe Datenmengen \u00fcber Dutzende LVDS-Datenleitungen \u00fcbertragen werden m\u00fcssen. Auch spezielle Bildverarbeitungsprojekte, die einen robusten Datentransfer \u00fcber Kabel innerhalb des Ger\u00e4tes erfordern, werden von dieser Technologie profitieren, z.B. bei der hochaufl\u00f6senden Bilderfassung in der Qualit\u00e4tskontrolle, in satellitengest\u00fctzten Aufnahmesystemen, im Area Mapping, sowie beim Dokumenten-Scanning oder in der Mikroskopie.“<\/p>\n

    Weiterf\u00fchrende Informationen<\/strong><\/h2>\n
      \n
    • IP Core: verschl\u00fcsselte RTL (VHDL), VHDL-Quellcode (optional), Simulationsumgebung (ModelSim)<\/li>\n
    • Dokumentation: Benutzerhandbuch, Referenz-Design f\u00fcr EK-U1-KCU105-G<\/li>\n
    • Verifizierte Xilinx-Komponenten: Artix-7, Kintex-7, Zynq-7000, Kintex US, Kintex US+, Zynq US+<\/li>\n
    • Referenzbeispiel: Xilinx KCU105-G (im Development Kit enthalten)<\/li>\n
    • Software-Verf\u00fcgbarkeit: ab Ende November 2020<\/li>\n<\/ul>\n<\/div>\n<\/div>\n","protected":false},"excerpt":{"rendered":"

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